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郭靖

作品数:42 被引量:6H指数:2
供职机构:中北大学更多>>
发文基金:国家自然科学基金更多>>
相关领域:电子电信自动化与计算机技术航空宇航科学技术文化科学更多>>

文献类型

  • 40篇专利
  • 1篇期刊文章
  • 1篇学位论文

领域

  • 7篇电子电信
  • 4篇自动化与计算...
  • 1篇航空宇航科学...
  • 1篇文化科学

主题

  • 22篇电路
  • 18篇硬件开销
  • 13篇抗辐射
  • 13篇传输门
  • 12篇锁存
  • 11篇辐射环境
  • 10篇电荷共享
  • 10篇锁存器
  • 10篇集成电路
  • 10篇航天航空
  • 8篇电路应用
  • 8篇冗余
  • 8篇功耗
  • 8篇存储器
  • 6篇晶体管
  • 6篇抗辐照
  • 5篇低功耗
  • 5篇高频
  • 5篇高频电路
  • 4篇低频

机构

  • 42篇中北大学
  • 15篇齐齐哈尔大学
  • 1篇哈尔滨理工大...
  • 1篇信息产业部电...

作者

  • 42篇郭靖
  • 15篇朱磊
  • 8篇蔡宣明
  • 2篇丑修建
  • 2篇熊继军
  • 2篇刘梦然
  • 2篇简泽明
  • 2篇薛晨阳
  • 2篇刘源
  • 2篇张文栋
  • 2篇刘俊
  • 2篇王任鑫
  • 2篇曾瑞
  • 1篇黄海
  • 1篇孙宇

传媒

  • 1篇微电子学与计...

年份

  • 1篇2023
  • 5篇2022
  • 13篇2020
  • 11篇2019
  • 5篇2018
  • 3篇2017
  • 3篇2016
  • 1篇2014
42 条 记 录,以下是 1-10
排序方式:
一种新型低冗余二维矩阵码对存储器进行加固方法
一种新型低冗余二维矩阵码对存储器进行加固方法,涉及低冗余二维矩阵码构造方法。解决了现有二维矩阵码对存储器中的多单元翻转进行纠错保护时,冗余位过多的问题。对于一个i位信息位,将其排列成一个m×n的矩阵,m为行数,n为列数;...
郭靖朱磊刘文怡熊继军
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在中低频电路系统中应用的抗电荷共享D锁存器
在中低频电路系统中应用的抗电荷共享D锁存器,属于集成电路可靠性中的抗辐射加固领域。解决了传统的抗电荷共享D锁存器存在硬件开销大、器件面积大、功耗高、传输时间长的问题。本发明将晶体管TP1的栅极、晶体管TN3的栅极和节点S...
郭靖蔡宣明
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低冗余抗双节点翻转的D锁存器
低冗余抗双节点翻转的D锁存器,属于集成电路可靠性中的抗核加固领域。解决了传统抗辐照D锁存器所需硬件多、功耗高、延迟时间长以及虽然可实现抗双节点翻转,但存在抗双节点翻转的能力差,甚至无法实现对双节点翻转的容错问题。包括NM...
郭靖
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一种面向高频电路应用的抗电荷共享的D锁存器
一种面向高频电路应用的抗电荷共享的D锁存器,属于集成电路可靠性中的抗辐射加固领域。解决了应用在高频电路中抗电荷共享的D锁存器存在硬件开销很大、敏感节点多、功耗高、传输时间长和恢复时间长的问题。本发明将晶体管TN1的栅极连...
郭靖蔡宣明
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一种基于拉丁方矩阵构造的低冗余矩阵码对存储器进行加固方法
一种基于拉丁方矩阵构造的低冗余矩阵码对存储器进行加固方法,涉及低冗余矩阵码构造方法。解决了现有编码器和译码器对存储器进行加固的方式,影响存储器性能的问题。针对单粒子翻转效应中的多单元翻转效应,本发明基于拉丁方矩阵构造的低...
郭靖朱磊刘文怡熊继军
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基于双互锁单元的抗辐照D锁存器
基于双互锁单元的抗辐照D锁存器,属于集成电路可靠性中的抗核加固领域。解决了传统的抗辐照D锁存器所需硬件多、功耗高、延迟时间长以及虽然可实现抗双节点翻转,但存在抗双节点翻转的能力差,甚至无法实现对双节点翻转的容错的问题。包...
郭靖
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一种角度可调的微角锥反射镜阵列结构及其制造方法
本发明涉及微角锥反射镜,具体是一种角度可调的微角锥反射镜阵列结构及其制造方法。本发明解决了现有微角锥反射镜的制造方法因组装工艺限制而无法确保微角锥反射镜的成品率和工作性能的问题。一种角度可调的微角锥反射镜阵列结构,包括正...
王任鑫丑修建薛晨阳张文栋刘俊熊继军简泽明刘梦然郭靖刘源曾瑞
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抗核加固的D锁存器
抗核加固的D锁存器,属于集成电路可靠性中的抗核加固领域。解决了传统的D锁存器所需硬件多、功耗高、延迟时间长以及虽然可实现抗双节点翻转,但存在抗双节点翻转能力差,甚至无法实现对双节点翻转的容的问题。本发明包括NMOS晶体管...
郭靖
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一种面向高频电路应用的抗电荷共享的D锁存器
一种面向高频电路应用的抗电荷共享的D锁存器,属于集成电路可靠性中的抗辐射加固领域。解决了应用在高频电路中抗电荷共享的D锁存器存在硬件开销很大、敏感节点多、功耗高、传输时间长和恢复时间长的问题。本发明将晶体管TN1的栅极连...
郭靖蔡宣明
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基于排序网络的大数逻辑门电路设计被引量:4
2016年
针对传统大数逻辑门(Majority Logic Gate,MLG)高开销的问题,构造了基于排序网络的MLG电路,并以8输入的排序网络为例,使用两个4输入排序网络、四个与门以及1个或门来实现大数逻辑值.采用VerilogHDL编写代码,使用ModelSim仿真工具进行了功能验证.相比于传统的MLG,该电路可以有效地缩小45.11%的面积、降低60.43%的功耗和减小35.44%的延迟冗余.仿真结果表明,构造的电路可以完成正确的大数逻辑功能.
孙宇郭靖朱磊
关键词:存储器单粒子翻转
共5页<12345>
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